Examples of using Memory controller in English and their translations into Korean
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Colloquial
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Ecclesiastic
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Ecclesiastic
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Programming
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Computer
Thus, the memory controller 5 will be responsible for the transmission of the whole quantity of data,
따라서, 메모리 제어기(5)가 전체 데이터 량의 전송 책임이 있으며,Unfortunately, the memory controller doesn't support any of the new esoteric DRAMs(SDRAM,
불행하게도, 메모리 콘트롤러는 새로운 DRAM(SDRAM, EDO, BEDO)이나 동기화 캐시The memory controller 121 includes a central processing unit(CPU)
The chipset 204 includes a memory controller hub 220 and an input/output(I/O) controller hub 222.
상기 칩셋(204)은 메모리 제어기 허브(memory controller hub)(220) 및 입력/출력 제어기 허브(input/output (I/O) also known as a Graphics and Memory Controller Hub(GMCH) in Intel systems.
일컬어 도표와 기억 관제사 허브 (GMCH) 포함합니다.In this embodiment, the NAND Flash memory 3 can also be processed directly, without data transmission via the memory controller 5.
이 실시예에서, NAND 플래시 메모리(3)는 또한 메모리 제어기(5)를 통한 데이터 전송 없이, 직접 프로세싱될 수도 있다.RAM 606 is configured as multiple DDR SDRAM(Double Data Rate Synchronous Dynamic RAM) that are independently controlled by the memory controller 602 via separate buses(not shown).
RAM(606)은 개별 버스(도시되지 않음)를 통해 메모리 컨트롤러(602)가 독립적으로 제어하는 복수의 DDRSDRAM(Double Data Rate Synchronous Dynamic RAM)으로서 구성된다.This logical address information is then translated by a memory controller function 173 into physical addresses of metablocks and metapages of the memory 165.
그러면 이 논리 어드레스 정보는 메모리 제어기 기능(173)에 의해 메타블록들 및 메모리(165)의 메타페이지들의 물리 어드레스들로 번역된다.such as a system control point unit, or even within the memory controller.
심지어는 메모리 컨트롤러 내에도 존재할 수 있다.After this, the memory controller 5 sets the corresponding control signals in the first bus 6,
그런 다음, 메모리 제어기(5)는 대응되는 제어 신호를 제1 버스(6)에 인가하여,Memory controller 201 can include additional components not illustrated here so as not to obscure embodiments of the present disclosure.
메모리 제어기(201)는 본 발명의 실시예들을 모호하게 하지 않도록 여기서 예시되지 않는 부가적인 컴포넌트들을 포함할 수 있다.Additionally, other logic blocks such as a memory controller or graphics controller can also be located on a system on a chip.
그에 부가하여, 메모리 제어기 또는 그래픽 After this, the memory controller 5 uses the control bus 12 to inform the processor 14 that the data has been transmitted.
그런 다음, 메모리 제어기(5)는 제어 버스(12)를 이용하여 데이터가 전송되었음을 프로세서(14)에 알린다.When used, the memory controller calculates and stores the lengths of the data groups.
사용될 때, 메모리 제어기는 데이터 그룹들의 길이들을 계산하여 저장한다.The P2P memory controller performs one read in response to each local bus request from the primary ATU.
상기 P2P 메모리 제어기는 상기 메인 ATU로부터의 각각의 로컬 버스 요구에 응답하여 한가지의 판독을 수행한다.At least one metablock 167 is usually allocated as a reserved block for storing operating firmware and data used by the memory controller.
적어도 한 메타블록(167)은 늘, 메모리 제어기에 의해 사용되는 작동 펌웨어 및 데이터를 저장하기 위한 유보된 블록으로서 할당된다.The memory controller provides a bus monitor 113 for detecting address ranges which do not return a external RDYRCV signal.
상기 메모리 제어기는 외부 RDYRCV 신호를 복귀시키지 않는 주소 범위를 검출하기 위해 버스 감시기(113)를 제공한다.Aside: someone suggested that they were getting bad performance on a 21066 because the 21066 memory controller was only running at 33MHz.
Aside: 어떤 사람은 21066 메모리 콘트롤러가 33MHz에서만 돌아가기 때문에 21066에서 나쁜 성능을 가진다고 생각한다.A memory controller, in advance of issuing a memory request,
메모리 컨트롤러는, In another embodiment, memory controller 104 may be referred to as a north bridge.
또 다른 실시예에서, 메모리 컨트롤러(504)는 노스 브리지(north bridge)로 지칭될 수 있다.
